第10讲VHDL语言时序逻辑电路设计讲稿

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1、EDA技术实用教程时钟的描述方法时钟的描述方法上升沿：上升沿：CPEVENT AND CP=1下升沿：下升沿：CPEVENT AND CP=0CP=0CP=0CP=1CP=1CPEVENTCPEVENTCPEVENTD触发器描述触发器描述1nQnQDQn1（上升沿有效）上升沿有效） 边沿边沿D D触发器的特性方触发器的特性方程程：D触发器描述触发器描述D触发器描述触发器描述D触发器描述触发器描述D触发器描述触发器描述上升沿上升沿D触发器描述触发器描述方法一：使用信号属性函数方法一：使用信号属性函数LIBRARY IEEE;USE IEEE.STD_LOGIC_1164.ALL;ENTITY D

2、_reg ISPORT(D,CP:IN STD_LOGIC;Q:OUT STD_LOGIC);END D_reg;ARCHITECTURE test OF D_reg ISBEGINPROCESS(CP)BEGINIF (CPEVENT AND CP=1) THENQ=D;END PROCESS;END test;方法二：使用方法二：使用WAIT 语句语句LIBRARY IEEE;USE IEEE.STD_LOGIC_1164.ALL;ENTITY D_reg ISPORT(D,CP:IN STD_LOGIC;Q:OUT STD_LOGIC);END D_reg;ARCHITECTURE te

3、st OF D_reg ISBEGINPROCESSBEGINWAIT UNTIL CP=1;Q=D;END PROCESS;END test;上升沿上升沿D触发器描述触发器描述方法三：使用上升沿检测函数方法三：使用上升沿检测函数LIBRARY IEEE;USE IEEE.STD_LOGIC_1164.ALL;ENTITY D_reg ISPORT(D,CP:IN STD_LOGIC;Q:OUT STD_LOGIC);END D_reg;ARCHITECTURE test OF D_reg ISBEGINPROCESS(cp)BEGINIF (rising_edge(cp) THENQ=D;E

4、ND IF;END PROCESS;END test;上上升升沿沿D触触发发器器描描述述方法四：使用进程的启动特性方法四：使用进程的启动特性LIBRARY IEEE;USE IEEE.STD_LOGIC_1164.ALL;ENTITY D_reg ISPORT(D,CP:IN STD_LOGIC;Q:OUT STD_LOGIC);END D_reg;ARCHITECTURE test OF D_reg ISBEGINPROCESS（CP）BEGINIF CP=1 THENQ=D;END IF;END PROCESS;END test;上上升升沿沿D触触发发器器描描述述上升沿上升沿D触发器描述触

5、发器描述下降沿下降沿D触发器描述触发器描述方法一：使用信号属性函数方法一：使用信号属性函数LIBRARY IEEE;USE IEEE.STD_LOGIC_1164.ALL;ENTITY D_reg ISPORT(D,CP:IN STD_LOGIC;Q:OUT STD_LOGIC);END D_reg;ARCHITECTURE test OF D_reg ISBEGINPROCESS(CP)BEGINIF (CPEVENT AND CP=0) THENQ=D;END PROCESS;END test;方法二：使用方法二：使用WAIT 语句语句LIBRARY IEEE;USE IEEE.STD_L

6、OGIC_1164.ALL;ENTITY D_reg ISPORT(D,CP:IN STD_LOGIC;Q:OUT STD_LOGIC);END D_reg;ARCHITECTURE test OF D_reg ISBEGINPROCESSBEGINWAIT UNTIL CP=0;Q=D;END PROCESS;END test;下降沿下降沿D触发器描述触发器描述方法三：使用下降沿检测函数方法三：使用下降沿检测函数LIBRARY IEEE;USE IEEE.STD_LOGIC_1164.ALL;ENTITY D_reg ISPORT(D,CP:IN STD_LOGIC;Q:OUT STD_LO

7、GIC);END D_reg;ARCHITECTURE test OF D_reg ISBEGINPROCESS(cp)BEGINIF (falling_edge(cp) THENQ=D;END IF;END PROCESS;END test;下下降降沿沿D触触发发器器描描述述方法四：使用进程的启动特性方法四：使用进程的启动特性LIBRARY IEEE;USE IEEE.STD_LOGIC_1164.ALL;ENTITY D_reg ISPORT(D,CP:IN STD_LOGIC;Q:OUT STD_LOGIC);END D_reg;ARCHITECTURE test OF D_reg IS